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- 从以下三个原因中选原因：
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| Multi-chiplet Simulator |
- A Methodology for Simulating Multi-chiplet Systems Using Open-source Simulators
- 王小航团队
- September 7–9, 2021
- NANOCOM
| （1）背景介绍 - Chiplet间的通信仿真缺乏精度比如：interposer级别的互连延迟、power model等
- 无法进行大规模的并行仿真，无法承担成百上千的cores并行仿真
- Chiplet的设计空间非常具有挑战性，因为设计空间比设计单个SoC要大得多。
（2）目的 - 提供一种使用开源模拟器模拟Multi-chiplet系统的方法
（3）结论 - 芯片间和芯片内大规模互连系统可并行仿真
- 提供的multi-chiplet系统包括：分布式和共享内存模型
- 提供了一个修改Gem5源码的开源Chiplet模拟器
（4）主要实现手段 - 远程读写协议
- 模拟器进程间通信和同步协议
- 内存模型和编程模型
（5）实验结果 - 实验配置和benchmarks
- 矩阵乘法和BFS实验结果表明：随着Chiplet数量增加性能会提升（S1的减少可能由于通信开销）
- S5(popnet网络模拟器)实验结果表明：随着包注入率增加网络延迟增大迅速
- 图8显示了不同模拟器使用不同数量的Chiplet进程并行化模拟时的仿真时间（矩阵乘法）
| 用于实验设计： - 了解多Chiplet间的仿真细节的具体实现
- 考虑如何和毕业设计“Chiplet设计空间探索”联系起来
- 如何复用该Chiplet模拟器实现需求
- (33条消息) 傻白探索Chiplet，A Methodology for Simulating Multi-chiplet Systems UsingOpen-source Simulators（十）_好啊啊啊啊的博客-CSDN博客
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| Deadlock-freedom Routing |
- Modular Routing Design for Chiplet-based Systems
- Jieming Yin.(AMD)
- 2018 ACM/IEEE 45th ISCA
| （1）背景介绍 - individual chiplets是独立设计的，有自己的NoC，无死锁且内部可以正常通信，但将几个NoC连接在一起可能会引入新的resource cycle，从而导致跨芯片之间的循环依赖关系，很容易导致死锁。
（2）目的 - 通过引入一种简单的，模块化的，优雅的方法来确保multi-chiplet system的deadlock-freedom
（3）结论 - 可在无需其它chiplets或interposer's NoC细节的情况下独立设计，而prior-art不支持这个属性，故可以在高性能的情况下消除死锁，开发了一种composable, highly-modular, chiplet-based的方法来实现各种拓扑的routing；
- 提出了一个关键抽象点：从单个chiplet的角度来看，系统的其余部分可以被抽象到单个虚拟节点中，基于此设置了boundary router 和 turn restriction的方法
（4）主要实现手段 - 尽可能地隔离chiplets和interposer的设计，允许对chiplets和interposer进行独立的负载均衡优化，同时保持整个系统的routing是deadlock-free的。
- Boundary Router Placement and Turn Restriction Algorithm
- Interposer NoC Confifiguration
（5）实验结果 - 实验设置和benchmark
- 对比试验1：Basic Throughput Evaluations with Synthetic Traffific
- 对比试验2：Application-level Impact
- 消融实验：broader applicabilityA.验证实验设置guideline的有效性
- 其它实验：Other Chiplet Packaging Options
| 了解课题背景: 了解多chiplet通信的死锁问题 (25条消息) 傻白探索Chiplet，Modular Routing Design for Chiplet-based Systems（十一）_好啊啊啊啊的博客-CSDN博客 |
